晶振 电容 晶振电容

晶振电容晶体元件的负载电容是指在电路中跨接晶体两端的总的外界有效电 容。是指晶振要正常震荡所需要的电容。一般外接电容，是为了使晶 振两端的等效电容等于或接近负载电容。要求高的场合还要考虑ic 输入端的对地电容。应用时一般在给出负载电容值附近调整可以得到 精确频率。此电容的大小主要影响负载谐振频率和等效负载谐振电 晶振的负载电容=[(Cd*Cg)/(Cd+Cg)]+Cic+C式中Cd,Cg 为分别接在晶振的两个脚上和对地的电容,Cic（集成电路内部电容） +C（PCB 上电容).就是说负载电容15pf 的话，两边个接27pf 不多了晶振 电容，一般a为6.5～13.5pF 各种逻辑芯片的晶振引脚可以等效为电容三点式振荡器. 引脚的内部通常是一个反相器,或者是奇数个反相器串联. 输出引脚XO 和晶振输入引脚 XI 之间用一个电阻连接, 对于 CMOS 芯片通常是数 欧之间.很多芯片的引脚内部已经包含 了这个电阻, 引脚外部就不用接了. 这个电阻是为了使反相器在振 荡初始时处与线性状态, 反相器就如同一个有很大增益的放大器, 以便于起振. 石英晶体也连接在晶振引脚的输入和输出之间, 等效 为一个并联谐振回路, 振荡频率应该是石英晶体的并联谐振频率. 晶体旁边的两个电容接地, 实际上就是电容三点式电路的分压电容, 接地点就是分压点. 以接地点即分压点为参考点, 振荡引脚的输入 和输出是反相的, 但从并联谐振回路即石英晶体两端来看, 形成一 个正反馈以保证电路持续振荡. 在芯片设计时, 这两个电容就已经 形成了, 一般是两个的容量相等, 容量大小依工艺和版图而不同, 但终归是比较小, 不一定适合很宽的频率范围. 外接时大约是数 PF 到数十 PF, 依频率和石英晶体的特性而定. 需要注意的是: 这两个 电容串联的值是并联在谐振回路上的, 会影响振荡频率. 当两个电 容量相等时, 反馈系数是 0.5, 一般是可以满足振荡条件的, 果不易起振或振荡不稳定可以减小输入端对地电容量,而增加输出 端的值以提高反馈量. 设计考虑事项： 1.使晶振、外部电容器（如果有）与 IC 之间的信号线尽可能保持最 短。

当非常低的电流通过IC 晶振振荡器时晶振 电容，如果线路太长，会使它 EMC、ESD与串扰产生非常敏感的影响。而且长线路还会给振荡器 增加寄生电容。 2.尽可能将其它时钟线路与频繁切换的信号线路布置在远离晶振连 接的位置。 4.将晶振外壳接地如果实际的负载电容配置不当,第一会引起线路参考频率的 误差.另外如在发射接收电路上会使晶振的振荡幅度下降(不在峰点), 影响混频信号的信号强度与信噪. 当波形出现削峰,畸变时,可增加负载电阻调整(几十K 百K).要稳定波形是并联一个1M左右的反馈电阻.

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